在討論CPU架構(gòu)或SoC性能時(shí),“內(nèi)存”這個(gè)詞出現(xiàn)的頻率極高。但你可能經(jīng)常聽到這三個(gè)概念:片上內(nèi)存 (On-chip Memory)、高速緩存 (Cache) 以及最近大火的 統(tǒng)一內(nèi)存 (Unified Memory)。它們雖然都負(fù)責(zé)數(shù)據(jù)交換,但在硬件底層的邏輯完全不同。
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高速緩存:硬件層面的“本能預(yù)判”
高速緩存(Cache)存在的唯一目的,就是為了填平CPU核心與系統(tǒng)主存(DRAM)之間那道深不見底的速度鴻溝。緩存的運(yùn)作完全由硬件邏輯自動(dòng)化管理,它更像是一個(gè)極其聰明的“預(yù)判專家”,基于局部性原理,默默地將CPU可能需要的數(shù)據(jù)從內(nèi)存中抓取到L1、L2或L3存中。對(duì)軟件開發(fā)者而言,緩存是完全透明的,你無法直接命令硬件把特定的變量鎖在L1緩存里,一切交給CPU內(nèi)部的控制器去調(diào)度。這種設(shè)計(jì)的精妙之處在于它極大地降低了編程復(fù)雜度,讓CPU能夠自主匹配讀寫節(jié)奏。
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片上內(nèi)存:可顯式操控的“精密工作臺(tái)”
與之相對(duì)的片上內(nèi)存(On-chip Memory)則更像是一塊“手動(dòng)操作間”。雖然它在物理位置上同樣集成在芯片內(nèi)部,通常也采用SRAM,但它擁有獨(dú)立的編址空間,和緩存的自動(dòng)化邏輯完全不同。片上內(nèi)存通常交由程序員控制,開發(fā)者會(huì)通過代碼明確指令,將最核心的算法權(quán)重或?qū)崟r(shí)指令流搬運(yùn)到這塊區(qū)域。這種“確定性”是緩存無法提供的——因?yàn)榫彺婵赡軙?huì)因?yàn)閺?fù)雜的替換算法意外“踢出”關(guān)鍵數(shù)據(jù)導(dǎo)致掉速,而片上內(nèi)存只要不被軟件重寫,數(shù)據(jù)就會(huì)穩(wěn)如泰山地待在原位,確保性能絕不波動(dòng)。
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PS5游戲機(jī)就廣泛使用片上內(nèi)存技術(shù)
值得注意的是,從技術(shù)角度上看,AMD的3D V-Cache技術(shù)是屬于片上內(nèi)存的范疇,但是在邏輯分類上,它依舊被歸類為緩存。
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還有,HBM(High Bandwidth Memory,高帶寬顯存)是最接近片上內(nèi)存的產(chǎn)品,但它物理上雖然同在一個(gè)殼子里(芯片封裝),距離核心實(shí)際不過微米級(jí)的物理距離,但是它仍然要通過顯存控制器來訪問。
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統(tǒng)一內(nèi)存:打破藩籬的“資源共享化”
如果說前兩者討論的是“芯片內(nèi)部如何提速”,那么統(tǒng)一內(nèi)存(Unified Memory)就是在系統(tǒng)架構(gòu)層面打破了傳統(tǒng)的“行政堡壘”。在傳統(tǒng)的非統(tǒng)一架構(gòu)中,CPU和GPU各自擁有一塊領(lǐng)地,兩者交換數(shù)據(jù)必須經(jīng)過漫長(zhǎng)的總線進(jìn)行物理拷貝,效率極低。這與傳統(tǒng)電腦中劃分一部分內(nèi)存給核顯也有雷同之處:統(tǒng)一內(nèi)存是真正的物理共享與地址統(tǒng)一,數(shù)據(jù)無需在CPU和GPU緩存間反復(fù)同步,而劃撥內(nèi)存共享給核顯使用,僅僅是物理空間的“割讓”,數(shù)據(jù)在處理時(shí)依然存在隱形的搬運(yùn)墻。
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統(tǒng)一內(nèi)存架構(gòu)直接拆掉了這道墻,讓CPU和GPU共享同一個(gè)物理內(nèi)存池,GPU可以直接讀取CPU剛剛算好的結(jié)果。這種“零拷貝”特性,正是蘋果M系列芯片在視頻剪輯和大規(guī)模模型推理中表現(xiàn)驚人的核心秘密。
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從宏觀視角來看,這三者其實(shí)構(gòu)成了一個(gè)嚴(yán)密的性能金字塔。統(tǒng)一內(nèi)存負(fù)責(zé)擴(kuò)大資源共享的基數(shù),從架構(gòu)上消除跨核心的搬運(yùn)損耗;高速緩存通過算法邏輯自動(dòng)優(yōu)化高頻數(shù)據(jù)的響應(yīng)速度;而片上內(nèi)存則為那些追求極限穩(wěn)定性的關(guān)鍵任務(wù)提供了私有的高速通道。正是這種層層遞進(jìn)、動(dòng)靜結(jié)合的存儲(chǔ)策略,才讓現(xiàn)代處理器在面對(duì)復(fù)雜任務(wù)時(shí),依然能保持行云流水般的響應(yīng)速度。
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